audio - VHDL 音频采样音量控制

标签 audio vhdl

我搜索了很多关于这个问题，但我找不到任何有用的...
问题是，我在 FPGA 芯片上产生回声效果。我已经准备好了一切，比如用于延迟、输入、输出延迟的 BRAM，但我不知道如何改变返回输入的输出音量，将它们混合在一起并再次发送到 BRAM ..
因为当我只是简单地将输出连接到输入时，它会使 BRAM 循环无限，但我需要将返回输入的输出音量更改为其音量的一半..
我读到它可以通过将样本向右移动来实现，但它会在样本上产生很多噪音..

我使用 16 位样本

因此，我正在询问有关如何控制 sample 量的想法，以及我准备的所有其他东西..

最佳答案

所以我找出了我的问题.. 我正在向右移动样本向量，但我只是通过 "0" & sample(15 downto 1)但它已签名，所以我不得不复制 MSB 而不是只添加简单的“0”..所以答案是

sample(15) & sample(15 downto 1)

这使样本成为原始体积的一半。它就像 sample * 0,5

关于audio - VHDL 音频采样音量控制，我们在Stack Overflow上找到一个类似的问题： https://stackoverflow.com/questions/30559583/

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